news 2026/7/19 10:57:11

嵌入式SCI串行通信：从UART原理到多处理器网络实战

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张小明

前端开发工程师

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嵌入式SCI串行通信：从UART原理到多处理器网络实战

1. 项目概述：从UART到SCI的嵌入式通信基石

在嵌入式系统开发中，设备间的数据交换是构建复杂应用的命脉。无论是工业控制器读取传感器数据，还是智能设备与上位机进行调试通信，一种简单、可靠、低成本的串行通信协议始终是工程师的首选。这就是我们今天要深入探讨的串行通信接口，即SCI。你可能更熟悉它的另一个名字——UART。没错，SCI本质上就是微控制器厂商对通用异步收发传输器的一种具体实现，它遵循UART的核心协议，但又在芯片内部集成了更丰富的控制和状态寄存器，使其更贴合特定微控制器的架构。以德州仪器的TMS320F28003x系列实时微控制器为例，其SCI模块不仅提供了标准的异步通信功能，还深度集成了针对多处理器系统的优化设计，如空闲线模式和地址位模式，这对于构建主从式分布式控制系统至关重要。理解SCI，不仅仅是理解如何配置波特率发送数据，更是掌握如何在资源受限的嵌入式环境中，设计出高效、稳定、可扩展的通信架构。

2. SCI核心架构与工作原理深度解析

要驾驭SCI，必须从它的“心脏”——内部架构开始。SCI模块的设计哲学是在硬件层面完成大部分繁琐的通信时序控制，将CPU解放出来处理更复杂的应用逻辑。

2.1 全双工通信的双引擎结构

SCI模块的核心是一个全双工、独立运行的收发系统。这意味着数据的发送和接收可以同时进行，互不干扰。其架构主要由以下几个关键部分组成：

  1. 发送器：负责将CPU准备好的并行数据，转换成符合UART格式的串行比特流，从SCITXD引脚发送出去。它的核心是一个发送移位寄存器和一个发送数据缓冲寄存器。CPU将待发送的数据写入缓冲寄存器，然后硬件自动将其加载到移位寄存器中，并按设定的波特率逐位移出。这种双缓冲结构是高效传输的关键，它允许CPU在上一字节正在发送时，就准备下一个要发送的字节，从而最大限度地利用总线带宽。

  2. 接收器：负责从SCIRXD引脚采样串行数据流，将其还原成并行数据供CPU读取。与发送器类似，它也包含一个接收移位寄存器和一个接收数据缓冲寄存器。外部数据逐位移入接收移位寄存器，当一个完整的字符（包括起始位、数据位、校验位和停止位）接收完毕后，硬件自动将数据从移位寄存器转移到数据缓冲寄存器，并置位“接收就绪”标志或产生中断通知CPU。

  3. 可编程波特率发生器：这是通信时序的节拍器。它通过对系统时钟进行分频，产生发送和接收数据位所需的精确时钟信号。波特率的计算公式通常为：波特率 = LSPCLK / (BRR + 1)，其中BRR是写入波特率寄存器的16位值。例如，在LSPCLK为50MHz时，要产生115200的波特率，需要计算BRR = (50,000,000 / (115200 * 8)) - 1 ≈ 53。这里的“8”是因为SCI内部通常以8倍或16倍于波特率的频率对数据进行采样以提高抗噪性。

  4. 控制与状态寄存器：这是CPU与SCI硬件交互的窗口。通过配置这些寄存器，我们可以设定数据格式、使能中断、查询错误状态。例如，SCICCR寄存器用于配置数据位长度、停止位和校验方式；SCICTL1和SCICTL2则用于使能发送/接收、选择多处理器模式等。

2.2 数据帧格式：NRZ编码的奥秘

SCI采用非归零编码格式。简单来说，在一位数据的持续时间内，信号电平保持恒定（高电平代表1，低电平代表0），不会在比特中间回到零电平。一个完整的NRZ数据帧包含以下部分：

  • 起始位：一个比特时间的低电平，标志着数据帧的开始，用于同步接收方的时钟。
  • 数据位：紧接着起始位，长度可编程为1到8位，通常我们使用8位（一个字节）。
  • 校验位：可选位，用于简单的错误检测。可以是奇校验或偶校验，确保数据位加校验位中“1”的个数为奇数或偶数。
  • 停止位：1个或2个比特时间的高电平，标志着数据帧的结束，并为接收方提供处理时间。

注意：起始位是通信同步的唯一参考点。接收器会持续监测SCIRXD引脚，当检测到连续4个内部采样时钟周期的低电平时，才认为是一个有效的起始位，并开始按位采样。这种设计能有效滤除线上的短时噪声毛刺。

2.3 双缓冲与FIFO：降低CPU开销的利器

早期的UART只有一个缓冲寄存器，这意味着CPU必须在当前字节发送完成或接收完成的瞬间响应中断并处理数据，否则就会发生数据覆盖（上溢）或丢失（下溢）。SCI模块通过引入双缓冲和可选的16级FIFO彻底改变了这一局面。

  • 双缓冲机制：如前所述，发送和接收各有一个数据缓冲寄存器和一个移位寄存器。CPU操作缓冲寄存器，硬件操作移位寄存器。这为CPU处理数据提供了一个完整的字符传输时间窗口，极大地缓解了中断响应时间的压力。
  • 16级FIFO：这是双缓冲的超级增强版。发送和接收方向各自拥有一个16字节深的先进先出队列。对于发送，CPU可以一次性写入最多16个字节到发送FIFO，硬件会按顺序自动发送；对于接收，硬件可以连续接收最多16个字节存入接收FIFO，再一次性通知CPU读取。FIFO还允许设置中断触发水位线（例如，当接收FIFO中有8个数据时才产生中断），这能将中断频率降低一个数量级，对于高波特率通信或主频不高的MCU来说，是提升系统整体性能的关键。

3. 多处理器通信模式：构建高效主从网络

在工业自动化、楼宇控制等场景中，经常需要一个主控制器与多个从设备通过一条总线通信。SCI模块内置的两种多处理器通信协议——空闲线模式和地址位模式——正是为此而生。它们的核心思想是“唤醒寻址”：让所有从机平时处于“睡眠”监听状态，只有当地址匹配时，目标从机才被唤醒并接收后续数据。

3.1 空闲线多处理器模式

这种模式通过帧间的“空闲时间”来区分不同的数据块。其规则是：如果总线在停止位后保持高电平（空闲）超过10个比特时间，则下一个帧被视为一个新数据块的开始，且该块的第一个帧是地址帧。

工作流程如下：

  1. 所有从机的SCI将其SLEEP位（SCICTL1.2）置1，进入睡眠模式。在此模式下，接收器仍在工作，但只有检测到地址帧时才会置位RXRDY标志或产生中断。
  2. 主机要发送数据给某个从机时，先发送一个地址字节。为了标识这是一个新块的开始，主机必须在发送此地址前，确保总线有超过10个比特时间的空闲。
  3. 所有从机都会收到这个地址帧，并产生中断。在中断服务程序中，从机软件将收到的地址与自身预设的地址进行比较。
  4. 地址匹配的从机，将其SLEEP位清零，从而能够接收后续的所有数据帧，并产生接收中断。
  5. 地址不匹配的从机，保持SLEEP位为1，忽略后续的数据帧，直到检测到下一个长空闲周期（即下一个地址帧）。

发送块起始信号的方法：

  • 软件延时：在发送完上一个数据块的最后一帧后，程序主动等待超过10个比特时间，再发送地址。这种方法简单，但会白白浪费总线时间。
  • 利用TXWAKE标志：这是更高效的方法。在写入地址到SCITXBUF之前，先将TXWAKE位（SCICTL1.3）置1，然后向SCITXBUF写入一个任意值（内容无关）。当这个“任意值”帧被发送时，硬件会自动在其后插入一个精确的11比特空闲时间。紧接着，主机再写入真正的地址帧。这样，总线仅在必要时才空闲，效率更高。

实操心得：空闲线模式的“坑”与规避手册中特别提到一个关键点：在空闲线模式下，如果CPU读取接收FIFO中所有数据的时间超过了10个比特时间，SCI可能会错过检测紧接着的下一个块起始信号。这是因为RXWAKE逻辑只在首次检测到10比特空闲时置位一次，即使总线持续空闲，读取RXBUF（会清除WAKE条件）后也不会再次置位。规避方法：在中断服务程序末尾，读完所有数据后，有两种选择：

  1. 直接复位SCI的软件复位位SWRESET（SCICTL1.0），然后重新初始化接收器。
  2. 在读取RXBUF之前，先检查RXWAKE状态位（SCIRXST.1）。如果RXWAKE被置位，说明检测到了块起始，那么在本次中断服务程序结束时不要将SLEEP位置1，让接收器保持唤醒状态以接收紧随其后的地址帧。

3.2 地址位多处理器模式

这种模式在每一帧的数据格式中增加了一个额外的地址/数据位。如果一个帧的地址位为1，则表示该帧是地址帧；如果为0，则表示是数据帧。这样，数据块之间不再需要冗长的空闲时间进行分隔。

工作流程如下：

  1. 同样，所有从机置SLEEP位为1。
  2. 主机发送地址帧时，在写入SCITXBUF的同时，将TXWAKE位置1。硬件发送该帧时，会自动将地址位置1。
  3. 从机收到地址位为1的帧，产生中断，并比较地址。
  4. 地址匹配的从机清除SLEEP位，准备接收后续地址位为0的数据帧。
  5. 主机发送数据帧时，TXWAKE位保持为0，硬件发送的帧其地址位为0。

模式选择建议：

  • 地址位模式：适用于数据块较小（通常建议少于11字节）的场景。因为每个帧都增加了一个地址位，对于大数据块来说开销比例较小，效率高，且块间无需等待。
  • 空闲线模式：适用于数据块较大（通常大于12字节）的场景。虽然块间需要空闲时间，但每个帧没有额外的地址位开销，对于长数据块整体效率更高。

4. SCI模块的配置与驱动开发实战

理解了原理，我们进入实战环节。以TMS320F28003x的DriverLib库函数为例，我们来看如何一步步配置和使用SCI。

4.1 初始化配置步骤

一个完整的SCI初始化流程通常包括引脚配置、模块初始化、波特率设置、中断配置等。

// 假设使用SCI-A， GPIO28为SCIRXD， GPIO29为SCITXD void InitSCI(void) { // 1. 配置GPIO复用为SCI功能 // 先配置GPyGMUX，再配置GPyMUX，避免引脚电平毛刺 GPIO_setPinConfig(GPIO_28_SCIRXDA); GPIO_setPinConfig(GPIO_29_SCITXDA); // 2. 初始化SCI模块到已知状态（复位） SCI_performSoftwareReset(SCIA_BASE); // 3. 配置SCI通信参数 SCI_setConfig(SCIA_BASE, DEVICE_LSPCLK_FREQ, 115200, (SCI_CONFIG_WLEN_8 | SCI_CONFIG_STOP_ONE | SCI_CONFIG_PAR_NONE)); // 参数解释： // DEVICE_LSPCLK_FREQ: 低速外设时钟频率，需根据系统时钟配置确定 // 115200: 目标波特率 // SCI_CONFIG_WLEN_8: 8位数据位 // SCI_CONFIG_STOP_ONE: 1位停止位 // SCI_CONFIG_PAR_NONE: 无校验位 // 4. 使能FIFO功能（如果使用） SCI_enableFIFO(SCIA_BASE); // 使能FIFO SCI_resetTxFIFO(SCIA_BASE); // 复位发送FIFO SCI_resetRxFIFO(SCIA_BASE); // 复位接收FIFO SCI_setFIFOInterruptLevel(SCIA_BASE, SCI_FIFO_TX4, SCI_FIFO_RX4); // 设置中断触发水位线：发送FIFO<=4时产生中断，接收FIFO>=4时产生中断 // 5. 使能发送器和接收器 SCI_enableModule(SCIA_BASE); // 使能SCI模块时钟 SCI_enableTx(SCIA_BASE); // 使能发送功能 SCI_enableRx(SCIA_BASE); // 使能接收功能 // 6. 配置并开启中断（如果需要） SCI_enableInterrupt(SCIA_BASE, SCI_INT_RXFF); // 使能接收FIFO中断 Interrupt_register(INT_SCIA_RX, &SCIA_RX_ISR); // 注册中断服务函数 Interrupt_enable(INT_SCIA_RX); // 使能PIE级中断 }

4.2 数据收发操作

配置完成后，数据的收发就变得非常直观。

发送数据（查询方式）：

void SCI_SendByte(uint16_t base, uint16_t data) { while(SCI_getTxFIFOStatus(base) == SCI_FIFO_TX15); // 等待发送FIFO有空间（非满） SCI_writeDataBlockingFIFO(base, data); // 写入数据并阻塞直到进入FIFO } void SCI_SendString(uint16_t base, const char *str) { while(*str != '\0') { SCI_SendByte(base, *str++); } }

接收数据（中断方式）：在中断服务程序中，我们需要快速地将FIFO中的数据读取到应用程序的缓冲区中。

// 定义一个环形缓冲区 #define RX_BUFFER_SIZE 256 uint16_t sciRxBuffer[RX_BUFFER_SIZE]; uint16_t sciRxHead = 0, sciRxTail = 0; __interrupt void SCIA_RX_ISR(void) { uint16_t rxData; uint16_t status; status = SCI_getInterruptStatus(SCIA_BASE); SCI_clearInterruptStatus(SCIA_BASE, status); // 清除中断标志 // 检查是否是接收FIFO中断 if(status & SCI_INT_RXFF) { // 循环读取，直到接收FIFO为空 while(SCI_getRxFIFOStatus(SCIA_BASE) != SCI_FIFO_RX0) { rxData = SCI_readDataBlockingFIFO(SCIA_BASE); // 读取数据 // 将数据存入软件环形缓冲区，注意处理溢出 sciRxBuffer[sciRxHead] = rxData; sciRxHead = (sciRxHead + 1) % RX_BUFFER_SIZE; // 简单溢出检查：如果头追上了尾，丢弃最旧的数据（移动尾指针） if(sciRxHead == sciRxTail) { sciRxTail = (sciRxTail + 1) % RX_BUFFER_SIZE; } } } // 其他中断类型处理（如接收错误） else if(status & SCI_INT_RXERR) { // 读取状态寄存器，检查具体错误：帧错误、溢出错误、奇偶校验错误、间隔检测 uint16_t errorStatus = SCI_getRxStatus(SCIA_BASE); // 根据错误类型进行相应处理，如清空FIFO、记录错误日志等 SCI_resetRxFIFO(SCIA_BASE); // 通常需要复位接收FIFO以清除错误状态 } Interrupt_clearACKGroup(INTERRUPT_ACK_GROUP9); // 确认PIE中断 }

5. 高级功能与性能优化技巧

5.1 自动波特率检测

在某些需要自适应不同设备的场景（如Bootloader），SCI的自动波特率检测功能非常有用。该功能通过检测起始位的下降沿到第一个数据位边沿的时间间隔，自动计算并设置匹配的波特率。启用后，SCI硬件会自动调整波特率寄存器，无需软件进行复杂的计算和匹配。

启用方法：通常通过设置SCI_CTL寄存器中的ABDEN位，并在SCIRXD引脚上接收一个特定的同步字符（如0x55，其二进制为01010101，提供了丰富的边沿信息）来实现。

5.2 中断响应时间与可靠性保障

手册中关于“SCI模块中断反应时间”的注释是保证通信可靠性的金科玉律。它指出，从停止位的后沿到中断真正被触发，有大约0.875个比特时间的延迟。而SCI在中断服务程序完成前，不会开始读取下一个字节的起始位。这意味着，留给RX中断服务程序执行的时间窗口只有大约0.125个比特时间。

计算示例：在115200波特率下，一个比特时间约为8.68微秒。那么ISR的执行时间必须小于8.68 * 0.125 ≈ 1.085微秒。这对于许多包含复杂处理的ISR来说是非常苛刻的。

优化策略：

  1. 保持ISR极度精简：RX ISR的唯一任务应该是快速将数据从硬件FIFO搬运到更大的软件环形缓冲区中。任何解析、处理数据的逻辑都应放到主循环或低优先级任务中。
  2. 使用FIFO并提高水位线：将接收FIFO的中断触发水位线设高（例如8或12），这样每接收多个字节才产生一次中断，变相延长了平均每个字节可用的处理时间。
  3. 调整通信协议：
    • 要求发送方使用2个停止位：这为每个字节增加了整整一个比特时间的处理窗口。在上例中，ISR时间就变成了8.68 * 1.125 ≈ 9.77微秒，宽松了很多。
    • 在协议中增加字节间延时：与通信对端协商，在发送每个字节后主动插入一段延时。
    • 使用块传输与应答机制：改为以数据块为单位进行传输，每传输一块数据后等待接收方的应答，再进行下一块传输。

5.3 寄存器与DriverLib函数映射实战

用户提供的资料中给出了SPI和SCI寄存器到DriverLib函数的映射表。对于SCI，其思路是一致的。DriverLib库函数是对底层寄存器操作的封装，提供了更友好、可移植的API。例如：

  • SCI_setConfig()函数一次性配置了SCICCR（数据格式）、SCIHBAUD/SCILBAUD（波特率）等多个寄存器。
  • SCI_enableInterrupt()和SCI_disableInterrupt()函数用于操作SCICTL2和SCIFFTX/SCIFFRX中的中断使能位。
  • SCI_writeDataBlockingFIFO()函数内部会检查SCIFFTX寄存器中的TXFIFO状态，确保数据被成功写入。

使用DriverLib的优势：

  • 代码可读性高：函数名清晰地表达了意图。
  • 可移植性好：更换同一系列不同型号的MCU时，代码修改量小。
  • 减少错误：避免了直接操作寄存器时可能出现的位域设置错误。

6. 常见问题排查与调试心得

在实际开发中，SCI通信不出数据是最常见的问题。下面是一个系统性的排查清单：

现象可能原因排查步骤与解决方法
完全无收发1. 时钟未使能
2. 引脚复用配置错误
3. 模块未使能		1. 检查PCLKCRx寄存器中对应SCI模块的时钟门控位是否已开启。
2. 用示波器或逻辑分析仪检查SCITXD引脚，确认GPIO是否已正确复用为外设功能，而非普通IO。
3. 确认SCICTL1寄存器中的SWRESET位已释放（置1），且TXENA和RXENA位已使能。
能发不能收，或能收不能发1. 单方向功能未使能
2. 线路连接错误
3. 对方设备故障		1. 分别检查SCICTL1中的TXENA和RXENA位。
2. 确认SCITXD已连接到对端的RXD，SCIRXD已连接到对端的TXD。这是最常见的接线错误！
3. 环回测试：将SCITXD和SCIRXD短接，自发自收。若成功，则问题在外部链路或对端设备。
收到乱码1. 波特率不匹配
2. 数据格式不匹配
3. 电气电平不匹配		1.首要怀疑对象。双方计算波特率的时钟源和分频系数是否一致？用示波器测量一个字节的时长，反算实际波特率。
2. 检查双方的数据位、停止位、校验位设置是否完全相同。
3. 如果是RS-232电平，检查电平转换芯片（如MAX3232）是否工作正常；如果是TTL电平，检查共地是否良好。
通信不稳定，偶发错误1. 中断服务程序超时
2. 电源噪声或地线干扰
3. FIFO溢出		1. 参考第5.2节，优化RX ISR，或增加停止位/降低波特率。
2. 检查PCB布局，确保通信线路远离噪声源，电源滤波电容充足。
3. 检查SCIRXST寄存器中的OE（溢出错误）位。如果使能了FIFO，确保中断水位线设置合理，且ISR清空FIFO的速度够快。
多处理器模式下从机无响应1.SLEEP位未正确管理
2. 地址匹配逻辑错误
3. 块起始信号未正确产生		1. 确认从机初始化后SLEEP=1，收到匹配地址后清零，收完数据块后重新置1。
2. 调试时，让主机先发送一个广播地址（如0xFF），看所有从机是否都能唤醒，以排除地址匹配问题。
3. 在空闲线模式下，用逻辑分析仪检查地址帧前是否有大于10比特的空闲时间；在地址位模式下，检查地址帧的地址位是否为1。

调试利器——逻辑分析仪：一个支持串行协议解码的逻辑分析仪是调试SCI/UART的终极工具。它能直观地显示波形、解码出十六进制或ASCII数据、测量比特时间（从而验证波特率）、并标注出起始位、停止位和校验位，绝大多数通信问题都能在此现形。

最后，分享一个我调试多机通信时的深刻教训：在地址位模式下，我曾误以为只需要在发送地址帧时操作TXWAKE。实际上，在发送地址帧之前，需要先置位TXWAKE并写入一个“哑元”数据到SCITXBUF，以产生地址位为1的帧。紧接着，再写入实际地址值（此时TXWAKE已被硬件清零），这个地址帧的地址位才是1。这个双缓冲的TXWAKE/WUT机制需要仔细理解，否则从机永远检测不到地址。

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