news 2026/9/4 5:12:01

Cadence Allegro装配视图BOM生成：从EDA设计到生产制造的精准数据流

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张小明

前端开发工程师

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Cadence Allegro装配视图BOM生成：从EDA设计到生产制造的精准数据流

1. 这篇文章真正要解决的问题

如果你是一名硬件工程师、PCB设计师或项目经理，你是否曾为了一份准确的物料清单（BOM表）而反复核对原理图、PCB布局和采购清单，耗费数小时甚至一整天？你是否遇到过因为BOM表版本混乱，导致采购了错误的物料，造成项目延期和成本浪费？或者，当你需要向团队或客户展示一个复杂产品的物理装配关系时，是否苦于无法将抽象的电路板布局与直观的3D模型关联起来？

这些痛点，正是“创建装配视图”这个看似简单的步骤，在BOM表生成流程中扮演关键角色的原因。很多人以为BOM表就是一份Excel表格，列上器件型号和数量就完事了。但实际上，一份真正“好用”的BOM，尤其是用于生产制造的BOM，必须包含清晰的装配信息：哪个器件在板子的哪一面（Top/Bottom）？是插件（THT）还是贴片（SMT）？有没有特殊的装配顺序或工艺要求？

本文要解决的核心问题，就是如何从电子设计文件（如Cadence Allegro、Altium Designer、Mentor Xpedition等EDA工具）中，不仅提取出器件列表，更进一步生成带有装配视图信息的、可直接用于生产和采购的BOM表。我们将以业界广泛使用的Cadence Allegro工具为例，深入讲解从设计数据到装配视图BOM的完整流程。读完本文，你将能系统性地掌握：

  1. 理解装配视图在BOM中的核心价值：它远不止是“正面”和“反面”那么简单。
  2. 掌握在Allegro中准确设置器件装配层信息的方法：这是数据准确的源头。
  3. 学会使用脚本或工具（如Allegro X）导出包含器件层的BOM表：避免手动整理的痛苦。
  4. 了解如何将EDA的BOM与ERP/PLM系统对接：打通从设计到制造的数据流。
  5. 规避常见的“坑”：比如封装命名不规范导致的层信息识别错误、位号（RefDes）重复等问题。

2. 基础概念：BOM表与装配视图到底是什么？

在深入操作之前，我们必须统一认知。很多沟通障碍和操作错误，都源于对基本概念的理解偏差。

BOM表 (Bill of Materials)BOM表，即物料清单，是产品所需所有原材料、组件和子装配件的结构化列表。在电子领域，一个完整的PCB BOM通常包含以下核心字段：

  • 位号 (Reference Designator, RefDes)：如 R1, C2, U3。这是器件在PCB上的唯一标识。
  • 物料编码/型号 (Part Number)：如GRM155R71C104KA88D。这是采购和生产的关键依据。
  • 描述 (Description)：如 “CAP CER 0.1UF 16V X7R 0402”。
  • 数量 (Quantity)：该型号器件在单板上的使用总数。
  • 封装 (Footprint/Package)：如0402,QFN-48。影响贴片工艺。
  • 制造商/供应商 (Manufacturer/Supplier)：来源信息。

装配视图 (Assembly View)装配视图是BOM表的一个维度扩展，它回答了“物料如何被装配到产品上”的问题。对于PCB而言，装配视图的核心信息是“器件所在板层”。

  • TOP层：器件装配在电路板的顶层（通常为元件面）。
  • BOTTOM层：器件装配在电路板的底层（通常为焊接面）。
  • INTERNAL层：多见于埋容、埋阻等特殊工艺。
  • 装配面信息的意义：
    • 指导SMT产线编程：贴片机需要知道吸嘴从哪一面拾取器件。
    • 决定焊接工艺：TOP层器件可能采用回流焊，而BOTTOM层器件在二次回流时可能需要治具保护或采用波峰焊。
    • 生成装配图 (Assembly Drawing)：视觉化的指导文件，帮助工人进行手工装配或检修。
    • 成本与采购：不同装配面的器件，有时对应的加工费不同（如双面贴片比单面贴片贵）。

常见误区澄清：

  • 误区一：在PCB软件里看到的TOP/BOTTOM层就是装配层。不对。PCB设计中的层主要指导电层（信号层、电源层）、丝印层、阻焊层。器件的装配层属性通常存储在器件的属性（Property）或符号（Symbol）定义中，需要正确设置才能被BOM导出工具识别。
  • 误区二：所有器件都需要指定装配层。是的。即使是通孔插件（THT）器件，虽然引脚穿透板子，但其本体通常放置在某一侧，也需要明确的装配层信息。
  • 误区三：BOM只需要一份总表。看情况。对于生产，通常需要分面BOM（TOP BOM和BOTTOM BOM分开列出），甚至需要分工艺BOM（SMT BOM和THT BOM分开），以便不同车间或供应商处理。

理解了这些，你就会明白，为什么直接从原理图导出的BOM往往是不完整的——它缺失了来自PCB布局的物理装配信息。接下来，我们就进入实战环节。

3. 环境准备与数据源头治理

“垃圾进，垃圾出。” 要想导出一份准确的装配视图BOM，首先必须确保设计源数据的准确性。这比任何导出技巧都重要。

1. 设计工具确认本文以Cadence Allegro/OrCAD设计环境为例。请确保你拥有：

  • Cadence Allegro PCB Editor：用于PCB布局和属性管理。
  • Cadence OrCAD Capture或Allegro Design Entry HDL：用于原理图设计。
  • 版本建议：Allegro 17.4 或更新版本，其数据结构和脚本兼容性更好。但核心逻辑通用于多数版本。

2. 关键数据源头检查在开始导出前，请在Allegro PCB Editor中完成以下检查：

  • 器件封装库管理：

    • 最佳实践是在封装库（.dra/.psm文件）创建时，就为器件符号定义好默认的装配层属性。例如，一个表贴电容的封装，其ASSEMBLY_TOP层应该有相应的装配外形框。
    • 检查方法：在Allegro中打开一个器件的封装，查看Layout -> Layers，确认ASSEMBLY_TOP或ASSEMBLY_BOTTOM层是否有图形。

  • PCB设计中的器件属性：

    • 这是最直接的装配层信息存储位置。在Allegro PCB Editor中，选中一个器件，右键点击Show Element，或在Edit -> Properties中查看。
    • 关键属性：ASSEMBLY_TOP，ASSEMBLY_BOTTOM。对于插件，可能还有ASSEMBLY_NOTE。
    • 常见问题：器件被镜像（Mirror）后，其装配层属性可能不会自动翻转，需要手动检查或通过脚本批量校正。

  • 原理图与PCB的一致性：

    • 确保网表（Netlist）已正确导入，所有器件位号（RefDes）在PCB中都有对应，且没有冗余或丢失的器件。

3. 属性标准化建议为了后续脚本和工具能准确识别，建议对装配层属性进行标准化命名。例如：

  • 统一使用ASSEMBLY_TOP和ASSEMBLY_BOTTOM作为属性名。
  • 属性值可以设为YES、TRUE或直接留空（表示不属于该层），只要你的导出脚本能一致解析即可。

治理好数据源头，相当于为高楼打好了地基。接下来，我们开始构建导出流程。

4. 核心流程拆解：从设计数据到装配BOM

生成带装配视图的BOM不是一个单一操作，而是一个小流程。下图清晰地展示了从数据准备到最终输出的五个关键步骤：

flowchart TD A[源头: PCB设计文件] --> B(步骤1: 检查与设置<br>器件装配层属性) B --> C(步骤2: 编写/使用脚本<br>提取器件与层信息) C --> D{步骤3: 选择输出方式} D --> E[方式A: 导出至CSV/Excel] D --> F[方式B: 集成插件导出] E --> G(步骤4: 数据处理与校验<br>如分面、合并物料) F --> G G --> H(步骤5: 生成最终生产BOM<br>与装配图)

下面，我们详细拆解每一个步骤。

步骤1：检查与设置器件装配层属性这是所有工作的基础。你需要确保PCB上的每一个器件都有正确的装配面信息。

  • 手动检查（适用于小批量或排查问题）：
    1. 在Allegro PCB Editor中，执行菜单命令Display -> Color/Visibility...。
    2. 在Group中选择Stack-Up，确保ASSEMBLY_TOP和ASSEMBLY_BOTTOM层被赋予高亮颜色并可见。
    3. 在板上查看，器件本体所在的装配层图形应被显示出来。如果看不到，说明该器件的封装可能未正确定义装配层图形。
  • 批量设置（推荐，使用Skill脚本）： 手动设置几百个器件是不现实的。通常需要编写或使用现成的Skill脚本，根据器件在板上的放置面（TOP/BOTTOM），自动为其添加ASSEMBLY_TOP或ASSEMBLY_BOTTOM属性。
    • 逻辑：脚本遍历所有器件，判断其Place_Bound_Top/Bot或SYMBOL_TOP/BOTTOM属性，然后为其添加对应的ASSEMBLY_TOP/BOTTOM属性。

步骤2：提取信息——命令行与报表生成Allegro提供了强大的报表生成功能，可以通过命令行（Command）或脚本驱动。

  1. 打开Allegro PCB Editor并加载你的设计文件（.brd）。
  2. 在命令窗口（Command）输入以下命令生成基础器件列表报表：
    report device
    这个命令会生成一个文本报告，包含位号、器件类型、封装名等信息，但默认不包含装配层信息。
  3. 为了获取装配层信息，我们需要更定制化的输出。这通常需要通过File -> Export -> Placement导出布局信息，或者使用Tools -> Reports功能，自定义报表模板。然而，更高效的方式是使用Skill脚本直接访问数据库。

步骤3：核心技能——编写Skill脚本提取装配BOM这是实现自动化、精准导出的关键。下面是一个简化的Skill脚本示例，演示如何遍历器件并输出位号、器件名和装配层信息。

; 文件：export_assembly_bom.il ; 描述：一个简单的Skill脚本，用于导出包含装配层信息的BOM到CSV文件 ; 使用方法：在Allegro命令栏输入 “skill load “export_assembly_bom.il”” 然后 “skill ExportAssemblyBOM()” procedure( ExportAssemblyBOM() let( (outFile dbId symbol assyTop assyBottom refdes deviceName) ; 1. 打开文件对话框，让用户选择保存路径 outFile = outfile( getFilename(“选择保存CSV文件的路径和名称” “csv”) “w”) if( outFile == nil then printf(“用户取消操作.\n”) return() ) ; 2. 写入CSV表头 fprintf(outFile “RefDes,Device,Assembly_Top,Assembly_Bottom\n”) ; 3. 获取当前设计数据库并遍历所有器件 dbId = axlDBGetDesign() foreach( symbol axlDBGetDesign()->components ; 获取位号 refdes = symbol->refdes ; 获取器件名（来自原理图） deviceName = symbol->compDef->name ; 4. 获取装配层属性 assyTop = nil assyBottom = nil foreach( prop symbol->prop when( prop->name == “ASSEMBLY_TOP” assyTop = prop->value ) when( prop->name == “ASSEMBLY_BOTTOM” assyBottom = prop->value ) ) ; 5. 将属性值转换为更易读的格式（假设属性值为”YES”表示在该层） assyTop = if( assyTop == “YES” then “TOP” else “-“) assyBottom = if( assyBottom == “YES” then “BOTTOM” else “-“) ; 6. 写入一行数据 fprintf(outFile “%s,%s,%s,%s\n” refdes deviceName assyTop assyBottom) ) ; 7. 关闭文件 close(outFile) printf(“装配BOM已成功导出至: %s\n” getFilename()) ) )

脚本关键点解释：

  • axlDBGetDesign(): 获取当前设计数据库对象。
  • axlDBGetDesign()->components: 遍历设计中的所有器件。
  • symbol->prop: 获取器件的属性列表，并从中查找我们关心的ASSEMBLY_TOP和ASSEMBLY_BOTTOM。
  • 该脚本将输出一个CSV文件，包含四列：位号、器件名、是否在TOP层、是否在BOTTOM层。

步骤4：数据处理与分面BOM生成导出的原始数据可能需要进一步处理：

  • 分面：在Excel或使用脚本（如Python的pandas库），根据Assembly_Top和Assembly_Bottom列，将器件列表拆分成TOP面BOM和BOTTOM面BOM。
  • 合并物料：将拆分后的BOM，按Device（物料编码）合并数量，生成用于采购的汇总BOM。
  • 格式转换：转换为公司规定的ERP或PLM系统导入模板格式。

步骤5：生成装配图除了表格数据，生产还需要视觉化的装配图。在Allegro中：

  1. 通过Color/Visibility设置，仅显示TOP层的Pin、Outline、RefDes（丝印）以及ASSEMBLY_TOP层图形，隐藏所有其他层。
  2. 使用File -> Export -> PDF功能，选择Plot模式，生成TOP面装配图PDF。
  3. 同理，生成BOTTOM面装配图。注意BOTTOM面视图通常是镜像的，以便从装配面观察，Allegro在导出时可以选择“Mirror”选项。

5. 进阶应用：利用Allegro X与第三方工具

对于不想深入编写脚本的用户，一些增强工具和第三方集成提供了更便捷的解决方案。

Allegro X / Allegro X AICadence的新一代平台Allegro X提供了更现代化的UI和增强的数据处理能力。其BOM导出功能可能内嵌了更多选项。

  • 操作路径：在Allegro X PCB Editor中，尝试Tools -> Database或File -> Export下的新菜单项，寻找如Bill of Materials...或Report Generation的选项。
  • 关键点：在导出设置中，仔细查找包含“Placement”、“Layer”、“Assembly”等相关字段的选项，并将其添加到输出列中。这可能是以勾选框或字段选择器的形式存在。

与SolidWorks等机械设计软件协同在机电一体化设计流程中，PCB的装配信息需要传递给机械设计软件进行整机装配验证。

  • 流程：从Allegro通过IDX(Intermediate Data eXchange) 或STEP格式导出带有器件装配信息的3D模型。
  • 在SolidWorks中：导入PCB的STEP文件后，可以利用其“BOM表”功能，基于导入的模型特征（包含来自Allegro的器件属性）生成装配BOM。这确保了机电BOM的一致性。

对接ERP/PLM系统这是BOM数据流的终点。目标是生成一个包含物料编码、描述、数量、位号、装配面、供应商等完整信息的文件，通常为CSV或Excel格式，并能被ERP系统（如SAP, Oracle）或PLM系统（如Windchill, Teamcenter）直接导入。

  • 标准化映射：你的导出脚本或工具输出的字段名，需要与ERP/PLM系统的导入模板字段名一一对应。
  • 数据清洗：确保物料编码是ERP系统中已存在的有效编码，描述格式符合规范，位号字符串无误（无特殊字符，分隔符正确）。

6. 运行结果与效果验证

执行完导出脚本或操作后，如何验证结果的正确性？

1. 检查导出的CSV/Excel文件：

  • 完整性：检查位号列表是否与PCB设计中的器件总数一致。可以对比Allegro中Tools -> Quick Reports -> Component Report的输出。
  • 准确性：抽样检查。在PCB板上随机选取几个TOP层和BOTTOM层的器件，在导出的BOM中查找其对应的行，确认Assembly_Top和Assembly_Bottom列的值是否正确。
  • 格式：检查是否有乱码，分隔符是否正确，是否存在多余的空行或空格。

2. 可视化验证（最有效的方法）：

  • 在Allegro中高亮检查：在Allegro PCB Editor中，使用Display -> Color/Visibility仅打开TOP层相关图形（如ASSEMBLY_TOP,REFDES），然后对照TOP BOM列表，观察是否所有应出现在TOP面的器件都被高亮显示，且没有遗漏。对BOTTOM层重复此操作。
  • 利用筛选功能：将导出的BOM在Excel中打开，使用筛选功能，分别筛选出Assembly_Top列为“TOP”和Assembly_Bottom列为“BOTTOM”的行。统计其数量，应与你在PCB中观察到的两面器件数量大致相符（需考虑正反面都有装配的器件，如某些连接器）。

3. 与生产部门核对：将生成的分面装配图（PDF）和分面BOM（Excel）一并提供给SMT工程师或生产负责人进行预审。他们从生产工艺角度能快速发现不合理之处，例如：

  • BOTTOM面是否存在过重或过大的器件（可能导致二次回流时掉落）。
  • 是否有器件的推荐装配面与你的设置不符（查阅器件数据手册）。

7. 常见问题与排查思路

在生成装配视图BOM的过程中，你几乎一定会遇到下面这些问题。这里提供清晰的排查路径。

问题现象可能原因排查方式解决方案
导出BOM中所有器件的装配层均为空或错误1. 器件封装库中未定义装配层图形或属性。
2. PCB设计中的器件未继承或设置装配层属性。
3. 导出脚本/工具读取的属性名与实际属性名不匹配。		1. 打开一个典型器件的封装，检查ASSEMBLY_TOP/BOTTOM层。
2. 在PCB中选中几个器件，查看其Properties。
3. 检查脚本中prop->name匹配的字符串。		1. 补充或修正封装库。
2. 运行批量设置属性的Skill脚本。
3. 修改脚本，使其与设计中的属性名一致。
部分插件器件（THT）也被标记在了TOP或BOTTOM层插件器件的装配层定义可能不同。有时其属性为ASSEMBLY_NOTE或通过其他工艺文件定义。检查插件器件的属性列表，寻找如MOUNTING_HOLE、THRU_HOLE或包含ASSEMBLY字样的其他属性。修改导出逻辑，对插件器件进行特殊处理。例如，根据封装名前缀（如TH_）或特定属性，在BOM中将其装配面标记为“THRU”或“BOTH”。
位号（RefDes）在BOM中重复或缺失1. 设计中存在位号重复的器件（DRC可能不检查此项）。
2. 原理图与PCB同步时位号未更新或出错。
3. 导出脚本遍历对象有误，漏掉了某些器件（如机械孔、测试点）。		1. 在Allegro中使用Tools -> Quick Reports -> Component Report检查位号唯一性。
2. 重新导入网表，确保一致性。
3. 确认脚本遍历的是axlDBGetDesign()->components。		1. 手动或通过脚本修正重复位号。
2. 执行正确的原理图与PCB同步流程。
3. 在脚本中过滤掉非电子器件（symbol->compDef->type != ‘MECHANICAL’）。
生成的装配图PDF中器件丝印模糊或缺失1. PDF导出设置中分辨率太低。
2. 丝印层（REFDES）在Color/Visibility中被关闭或颜色与背景相同。
3. 字体在PDF中未被嵌入。		1. 检查File -> Export -> PDF的Plot设置，提高DPI（如600 DPI）。
2. 导出前确认REFDES层在所有视图下均可见且颜色对比明显。
3. 在PDF设置中勾选“嵌入所有字体”。		调整PDF导出设置，并在屏幕上预览确认后再输出最终文件。
BOM导入ERP系统时失败1. 字段格式不匹配（如日期、数字格式）。
2. 存在ERP系统不允许的特殊字符（如/,&, 中文括号）。
3. 物料编码在ERP中不存在。		1. 仔细对比ERP导入模板的示例文件格式。
2. 在Excel中使用查找替换功能清理数据。
3. 提取BOM中的物料编码列表，与ERP物料库进行比对。		在导出脚本的最后一步或Excel中，增加一个“数据清洗和格式化”的环节，严格按照目标系统要求输出。

8. 最佳实践与工程建议

遵循以下实践，能让你和团队在BOM管理上事半功倍，减少返工和沟通成本。

1. 建立并强制执行设计规范

  • 封装库规范：强制要求所有封装都必须正确定义ASSEMBLY_TOP和ASSEMBLY_BOTTOM层图形及属性。这是“一劳永逸”的源头控制。
  • 属性命名规范：全公司或全项目组统一使用固定的属性名来存储装配信息，例如统一用ASSEMBLY_SIDE，值为TOP/BOTTOM/BOTH。
  • 位号命名规范：避免使用容易混淆的字符（如字母‘O’和数字‘0’，字母‘I’和数字‘1’）。

2. 流程自动化与版本化

  • 脚本化：将检查属性、导出BOM、生成装配图等一系列操作封装成一个完整的Skill脚本或Tcl脚本。设计师只需运行一个命令即可获得全套生产文件。
  • 集成到CI/CD：对于有条件的团队，可以将BOM生成和校验作为设计发布流程中的一个自动环节。每次提交PCB设计文件，自动生成BOM并与上次版本进行差异对比，提前发现物料变更。
  • 版本关联：生成的BOM文件、装配图PDF必须与PCB设计版本号（如Git标签）强关联。文件名中应包含版本号和日期。

3. 设计评审中加入BOM评审

  • 在PCB设计评审的最终阶段，增加一个“生产数据输出评审”环节。不仅评审电路和布局，还要评审即将发给工厂的Gerber、钻孔文件、BOM和装配图。
  • 重点检查BOM中是否有“禁用物料”、“即将停产物料”，以及装配图中是否有工艺警告（如BOTTOM面大器件）。

4. 维护一个“物料-封装-属性”映射表

  • 对于常用物料，可以建立一个Excel表或数据库，记录其标准封装、默认装配面（如有特殊要求）、推荐焊盘图形等信息。新设计时可以直接引用，保证一致性。

5. 备份与回滚

  • 在运行任何批量修改器件属性的脚本前，务必先备份原始设计文件（.brd）。
  • 导出最终BOM后，在发送给生产部门前，应在内部进行“双人复核”，尤其是对于首次打样或关键项目。

9. 总结与后续学习方向

生成一份带装配视图的BOM，远不是点击“导出报表”那么简单。它连接着电子设计（EDA）和物理制造（工厂）两个世界，是确保设计意图被准确无误传递到生产线的关键桥梁。

本文的核心判断是：装配视图BOM的准确性，70%取决于设计源头的规范性，30%取决于导出过程的严谨性。与其在导出时绞尽脑汁写复杂的解析脚本，不如在前端设计规范和库管理上投入精力。当你确保了每个封装都正确、每个器件属性都完整，导出就变成了一个水到渠成的、可自动化的简单操作。

通过本文，你应该已经掌握了在Cadence Allegro环境中生成装配视图BOM的完整逻辑链：从概念理解、数据检查、脚本编写/工具使用，到结果验证和问题排查。这套方法论同样可以迁移到其他EDA工具（如Altium Designer, Mentor PADS）上，只是具体的操作命令和脚本语法有所不同。

你的下一步行动建议：

  1. 立即检查：打开你当前或最近的一个PCB项目，按照第3节的方法，检查关键器件的装配层属性是否正确定义。
  2. 尝试导出：使用文中的Skill脚本示例或你熟悉的报表工具，尝试导出一份包含装配层信息的BOM，并与现有BOM进行对比。
  3. 流程优化：思考如何将本文的步骤融入你团队现有的设计发布流程中，形成一个标准化的检查清单（Checklist）。
  4. 深入学习：如果你对自动化感兴趣，可以进一步学习Cadence Skill或Tcl/Tk语言，编写更强大的工具，例如自动对比两版BOM的差异、自动生成采购申请单等。

希望这篇融合了原理、实战与陷阱剖析的长文，能成为你工程工具箱里一份可靠的参考资料。建议收藏，并在下次为BOM问题头疼时，回来按图索骥。

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